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[判断题]

若4位同步二进制加法计数器当前的状态是0111，下一个输入时钟脉冲后，其内容变为0111。（)

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第1题

若4位同步二进制加法计数器当前的状态是0111，下一个输入时钟脉冲后，其内容变为( )。

A.0111

B.0110

C.1000

D.0011

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第2题

4位二进制加法计数器设计实验要求用原理图输入设计法或Verilog HDL文本输入设计法设计4位二进制加法计

4位二进制加法计数器设计

实验要求

用原理图输入设计法或Verilog HDL文本输入设计法设计4位二进制加法计数器电路，建立4位二进制加法计数器的实验模式。通过电路仿真和硬件验证，进一步了解4位二进制加法计数器的功能和特性。

设计原理

4位二进制加法计数器的元件符号如图所示，CLK是时钟输入端，上升沿有效；CLRN是复位输入端，低电平有效；Q[3..0]是计数器的状态输出端；COUT是进位输出端。

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第3题

选用上升沿触发的触发器做的4位二进制同步加法计数器和选用下降沿触发的触发器做的4位二进制同步加法计数器的状态转换图是不一样的。（)

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第4题

若4位二进制加法计数器正常工作时，由0000状态开始计数，则经过43个输入计数脉冲后，计数器的状态应是( )。

A.0011

B.1011

C.1101

D.1110

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第5题

十进制加法计数器现时的状态为0010，经过3个时钟输入之后，其内容变为______，再经过30个时钟后，其内容变为___

___。

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第6题

选用上升沿触发的触发器做的4位二进制同步加法计数器和选用下降沿触发的触发器做的4位二进制同步加法计数器的时序图是不一样的。（)

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第7题

一个4位移位寄存器原来的状态为0000，如果串行输入始终为1，则经过4个移位脉冲后寄存器的内容为( )。

A.0001

B.0111

C.1110

D.1111

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第8题

将十进制数126.375转换成二进制数，应该是 _____。（A) 0111 1110.0110（B) 0111 1110.1110（C) 01

将十进制数126.375转换成二进制数，应该是 _____。

(A) 0111 1110.0110

(B) 0111 1110.1110

(C) 0111 1100.0110

(D) 0111 1100.1110

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第9题

74LS161是同步4位二进制加法计数器，试分析图7－55中的电路是几进制计数器，并画出其状态图。

74LS161是同步4位二进制加法计数器，试分析图7-55中的电路是几进制计数器，并画出其状态图。

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