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[主观题]
由D触发器和逻辑门构成的时序逻辑电路如图21－65所示，X，Y为输入端，CP为控制脉冲输入端，Q为输出端，（1)写出D的
由D触发器和逻辑门构成的时序逻辑电路如图21-65所示，X，Y为输入端，CP为控制脉冲输入端，Q为输出端，
(1)写出D的逻辑式。
(2)当输入端子保持在X=Y=0时，在图中画出输出端Q的波形图。
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