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[主观题]

设计一个时序电路，只有在连续两个或两个以上时钟作用期间，两个输入信号X1和X0一致时，输出信号才是1，其余情

设计一个时序电路，只有在连续两个或两个以上时钟作用期间，两个输入信号X₁和X₀一致时，输出信号才是1，其余情况输出为0。

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第1题

设计一个同步时序电路，它有两个输入X1和X2，一个输出Z。当X1和X2的输入连接两个以上一致时，输出Z为1，否则Z等于0。要求：用D触发器实现并建Verilog HDL模型。

设计一个同步时序电路，它有两个输入X₁和X₂，一个输出Z。当X₁和X2的输入连接两个以上一致时，输出Z为1，否则Z等于0。要求：用D触发器实现并建Verilog HDL模型。

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第2题

设计一个同步时序逻辑电路，给出设计过程，它有两个输入X1、X2和一个输出Z，当X1、X2连续两次以上一致时输出为1，

设计一个同步时序逻辑电路，给出设计过程，它有两个输入X₁、X₂和一个输出Z，当X₁、X₂连续两次以上一致时输出为1，甭则输出为0。

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第3题

列出下述问题的真值表，并写出逻辑表达式：（1)有a，b，c，3个输入信号，如果3个输入信号均为0或

列出下述问题的真值表，并写出逻辑表达式： (1)有a，b，c，3个输入信号，如果3个输入信号均为0或其中一个为1时，输出信号Y=1，其余情况下，输出Y=0； (2)有a，b，c，3个输入信号，当3个输入信号出现奇数个1时，输出F为1，其余情况下，输出F为0； (3)有3个温度探测器，当探测的温度超过60℃时，输出控制信号为1；如果探测的温度低于600C时，输出控制信号Z为0。当有两个或两个以上的温度探测器输出1时，总控制器输出1信号，自动控制调整设备，使温度降低到60℃以下。试写出总控制器的真值表和逻辑表达式。

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第4题

设计一个同步时序电路，它有两个输入X1和X2，一个输出Z。只有当X1输入3个或3个以上的1后，X2再输入一

个1时，输出Z为1，而在同一时刻两个输入不能同时为1。(提示：X，输入3个或3个以上的1可以不连续，只要其间没有X2为1插入即可，一旦Z为1，电路就回到起始状态)，要求： (1)用触发器和门电路实现设计； (2)用VHDL语言实现设计。

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第5题

有三个输入信号A、B、C，若三个同时为0或只有两个信号同时为1时，输出Y为1；否则Y为0，列出其真值表。

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第6题

图所示是一个三人表决电路，只有两个或三个输入为1（表示赞成)时，输出才是1。试分析该电路能否实现这一功

图所示是一个三人表决电路，只有两个或三个输入为1(表示赞成)时，输出才是1。试分析该电路能否实现这一功能。

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第7题

图12.16所示是一个三人表决电路，只有两个或三个输入为1（表示赞成)时，输出才是1。试分析该电路能否实现这一功

图12.16所示是一个三人表决电路，只有两个或三个输入为1(表示赞成)时，输出才是1。试分析该电路能否实现这一功能。

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第8题

试设计一个三线排队电路，采用3线-8线译码器74138实现。其功能是输入信号A、B、C通过排队电路后，分别由FA、FB、FC

试设计一个三线排队电路，采用3线-8线译码器74138实现。其功能是输入信号A、B、C通过排队电路后，分别由F_A、F_B、F_C输出，且在同一时间只能有一个信号通过。如果同时有两个或两个以上的信号出现，则输入信号按A、B、C的优先顺序通过。

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第9题

用与或非门设计一个4变量少数淘汰电路。当输入变量A，B，C，D中有两个或两个以下为1时，输出为高电平1，否则输出

低电平0。

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