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[主观题]

一个缓存-主存系统,采用50MHz的时钟,存储器以每一个时钟周期(简称周期)传输一个字的速率,连

一个缓存-主存系统,采用50MHz的时钟,存储器以每一个时钟周期(简称周期)传输一个字的速率,连续传输8个字,以支持块长为8个字的缓存,每字4个字节。假设读操作所花的时间是:1个周期接收地址,3个周期延迟,8个周期传输8个字;写操作所花的时间是:1个周期接受地址,2个周期延迟,8个周期传输8个字,3个周期恢复和写入纠错码。求出对应下述几种情况的存储器最大带宽。

(1)全部访问为读操作。

(2)全部访问为写操作。

(3) 65%的访问为读操作,35%的访问为写操作。

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第1题
8086CPU从偶地址访问内存1个字时需占用 个总线周期,而从奇地址访问内存1个字操作需占用 个总线周期。

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第2题
在一个16位的总线系统中,若时钟频率为100MHz,总线数据周期为5个时钟周期传输1个字。试计算总线的数据传输率。
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第3题
已知cachel采用直接映射方式,共16行,块大小为1个字,缺失损失为8个时钟周期;cache2也采用直接映射方式,共4行,块大小为4个字,缺失损失为11个时钟周期。假定开始时cache为空,采用字编址方式,要求找出一个访问地址序列,使得cache2具有更低的缺失率,但总的缺失损失反而比cachel大。

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第4题
CPU通过总线对内存或I/O端口存取(读或写)一个字节所需的时间是一个()。

A.总线周期

B.时钟周期

C.指令周期

D.存储器周期

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第5题
某计算机的主存采用体宽为8B的8体交叉存储器,数据总线的宽度为64位,读一个主存块的步骤: (1
某计算机的主存采用体宽为8B的8体交叉存储器,数据总线的宽度为64位,读一个主存块的步骤: (1)发送首地址到主存(一个总线时钟周期); (2)主存控制器接受到地址后,启动第一个模块准备数据,并每隔一个总线时钟启动下一个模块准备数据。每个存储模块花4个总线时钟准备好64位数据,总线上传输一个64位数据花一个总线时钟。请问: 该计算机的Cache缺失损失(从主存中读一个主存块到Cache的时间)至少为多少总线时钟周期?

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第6题
在一个32位的总线系统中,若时钟频率为100MHz,基本总线周期为5个时钟周期传输一个字,试计算总线的传输速率。
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第7题
某总线在一个总线周期中可并行传送8个字节数据,假设一个总线周期等于一个时钟周期,总线的时钟频
率为66 MHz,求总线的带宽。

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第8题
某同步总线的时钟频率为100MHz,宽度为32位,地址/数据线复用,每传输一个地址或数据占用一个时钟周期。若该总线支持突发(猝发)传输方式,则一次“主存写”总线事务传输128位数据所需要时间至少是

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第9题
一个4体低位交叉的存储器,假设存储周期为T, CPU每隔1/4存取周期启动-个存储体,试问依次访问64个字需多少个存取周期?

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