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把二个上升沿触发的D触发器接成图(a)所示电路，试画出CP、Q0、Q1的波形图，并说明电路的功能。设初始状态为Q0=Q1=0，画4个时钟脉冲。
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由JK触发器构成的电路如图所示，设初始状态为000，在时钟CP的作用下，画出Q2、Q1、Q0的波形图，写出时钟方程、驱动方程、状态方程及状态转换图，并说明电路的功能。
分析图21.51所示逻辑电路的逻辑功能，并说明其用途。设初始状态为0000，画出CP，Q0，Q1，Q2，Q3的工作波形图。
图21-63为一时序逻辑电路，试列出Q2，Q1，Q0的状态真值表，并根据图示CP脉冲波形画出Q2，Q1，Q0的波形图(设各触发器Q端初始为0)。
分析题图所示逻辑电路的逻辑功能，并说明其用途。设初始状态为“0000”。画出CP，Q0，Q1，Q2，Q3的波形图。
上升沿触发的维持-阻塞D触发器组成图(a)所示电路，输入波形如图(b)所示，画出Q1和Q2的波形。设Q初态为0。
图(a)所示是维持一阻塞D触发器的脉冲分频电路。试画出Q端对应输出波形，设初始状态为0。
电路如下图所示，已知CP和A的波形，画出触发器Q0、Q1及输出Vo的波形。设触发器的初始状态均为0。
设下降沿触发的JK触发器初始状态为0，
J、K信号如下图所示，试画出触发器Q端的输出波形。
电路如图7-48(a)所示，输入时钟脉冲CP如图7-48(b)所示，试画出输出Q0和Q1端的波形。设触发器的初始状态Q0=Q1=0。
