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[主观题]
如图是一个4选1数据选择器的逻辑图,D0~D3是被选数据输入端,A、B是选择输入端,F是输出端。试写出输出的逻辑表
如图是一个4选1数据选择器的逻辑图,D0~D3是被选数据输入端,A1、A0是选择输入端,F是输出端。试写出输出的逻辑表达式和电路的逻辑状态表,并说明当A1,A0为00、01、10、11时,分别是哪一个数据从输出端输出。
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如图是一个4选1数据选择器的逻辑图,D0~D3是被选数据输入端,A1、A0是选择输入端,F是输出端。试写出输出的逻辑表达式和电路的逻辑状态表,并说明当A1,A0为00、01、10、11时,分别是哪一个数据从输出端输出。
4选1数据选择器的设计
实验要求
用原理图输入设计法或Verilog HDL文本输入设计法设计4选1数据选择器电路,建立4选1数据选择器的实验模式。通过电路仿真和硬件验证,进一步了解4选1数据选择器的功能。
设计原理
4选1数据选择器的元件符号如图所示,其中a、b、c和d是4位数据输入端;s1和s0是控制输入端;z是数据输出端。当s1s0=00时,输出z=a;s1s0=01时,z=b;s1s0=10时,z=c:s1s0=11时,z=d。
数据选择器如下图所示,并行输入数据I3I2I1I0=1010,控制端X=0,A1A0的态序为00、01、10、11,试画出输出端L的波形。
16×4位EPROM有四个地址输入端和四个数据输出端,可以实现四输入变量、四输出变量的逻辑函数,画出阵列图。
用8选1数据选择器CT74151实现的电路如图所示,写出输出F的逻辑表达式,列出真值表并说明电路功能。