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[主观题]

已知如图4.2.41所示逻辑电路及count、C脉冲波形,试画出输出Q0、Q1、Q2的波形(设Q0、Q1、Q2的初始状态均为“0”)。

已知如图4.2.41所示逻辑电路及count、C脉冲波形,试画出输出Q0、Q1、Q2的波形(设Q0、Q1、Q2的初始状态均为“0”)。

已知如图4.2.41所示逻辑电路及count、C脉冲波形,试画出输出Q0、Q1、Q2的波形(设Q0、

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第1题
逻辑电路如下图所示,已知和X的波形,试画出Q1和Q2的波形。触发器的初始状态均为0。

逻辑电路如下图所示,已知CP和X的波形,试画出Q1和Q2的波形。触发器的初始状态均为0。

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第2题
已知时钟脉冲CP的波形如图21.25所示,试分别画出图21.26中各触发器输出端Q的波形。设它们的初始状态均为0。指

出哪个具有计数功能。

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第3题
主从型JK触发器组成的逻辑电路如图4.2.17(a)所示,输入波形如图4.2.17(b)所示,画出输出端的波形。设触发器的
主从型JK触发器组成的逻辑电路如图4.2.17(a)所示,输入波形如图4.2.17(b)所示,画出输出端的波形。设触发器的初始状态为Q=0。

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第4题
逻辑电路如图4.2.47所示,各触发器初始状态为“0”。已知CP、A、B的波形,试画出Q0、Q1和F的波形。
逻辑电路如图4.2.47所示,各触发器初始状态为“0”。已知CP、A、B的波形,试画出Q0、Q1和F的波形。

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第5题
电路如下图所示,已知CP和A的波形,画出触发器Q0、Q1及输出Vo的波形。设触发器的初始状态均为0。

电路如下图所示,已知CP和A的波形,画出触发器Q0、Q1及输出Vo的波形。设触发器的初始状态均为0。

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第6题
电路如图6.2.11(a)所示。触发器为主从型JK触发器,设初始状态均为0。试按给定的输入信号波形画出输出Q2、Q1端的

电路如图6.2.11(a)所示。触发器为主从型JK触发器,设初始状态均为0。试按给定的输入信号波形画出输出Q2、Q1端的波形。

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第7题
逻辑电路如图所示,列出状态表,已知C脉冲波形,画出输出Q0、Q1的波形,判断该计数器是几进制计数器,是加法还是

逻辑电路如图所示,列出状态表,已知C脉冲波形,画出输出Q0、Q1的波形,判断该计数器是几进制计数器,是加法还是减法?是异步还是同步?(设Q0、Q1的初始状态均为“0”)。

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第8题
电路如图21.32所示,试画出Q1和Q2的波形。设两个触发器的初始状态均为0。
电路如图21.32所示,试画出Q1和Q2的波形。设两个触发器的初始状态均为0。

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