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[主观题]

试用74LS138和逻辑门设计一个组合逻辑电路,该电路的输入X和输出F均为三位二进制数,其输入和输出关系如下:

当2<X<5,F=X+2;

当X≤2时,F=0;

当X≥5,F=1

要求列出真值表,画出卡诺图。

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第1题
试用输出低电平有效的3线-8线译码器和逻辑门设计一组合电路。该电路输入X,输出F均为3位二进制数。二者之间关

试用输出低电平有效的3线-8线译码器和逻辑门设计一组合电路。该电路输入X,输出F均为3位二进制数。二者之间关系如下:

2≤X≤5时,F=X+2

X<2时,F=1

X>5时,F=0

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第2题
某组合电路的输入X和输出Y均为三位二进制数。当X<2时,y=1;当2≤x≤5时,y=x+2;当x>5时,Y=0。
试用一片3-8译码器和少量逻辑门实现该电路。

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第3题
设计一个组合逻辑电路,已知输入X为一个四位二进制数,当X≤8时,输出Y=X;当X>8时,输出Y=X+1。试列出真值表,画出

设计一个组合逻辑电路,已知输入X为一个四位二进制数,当X≤8时,输出Y=X;当X>8时,输出Y=X+1。试列出真值表,画出逻辑电路图。可供选用的元件有:与非门、反相器、中规模四位二进制比较器及加法器(逻辑符号见图3.2.111)。

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第4题
设X,Y均为4位二进制数,它们分别是一个逻辑电路的输入与输出,当0≤X≤4时,Y=X+1;当5≤X≤9时,Y=X-1,且X不大于9。

设X,Y均为4位二进制数,它们分别是一个逻辑电路的输入与输出,当0≤X≤4时,Y=X+1;当5≤X≤9时,Y=X-1,且X不大于9。试用与非门实现该电路。

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第5题
设计一个判断4位二进制数A3A2A1A0状态的组合逻辑电路。要求: (1)当能被5整除时,输出F0=1,否则F0=0 (2)当A3

设计一个判断4位二进制数A3A2A1A0状态的组合逻辑电路。要求:

(1)当能被5整除时,输出F0=1,否则F0=0

(2)当A3A2A1A0小于3时,输出F1=1,否则F1=0;A3A2A1A0作为输入逻辑变量,F1、F0作为输出逻辑变量。要求用ROM实现,并画出简图。

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第6题
设计一个组合逻辑电路,该电路有三个输入信号ABC,三个输出信号XYZ,输入和输出信号均代表一个三位的二进制数。电路完成如下功能: 当输入信号的数值为0,1,2,3时,输出是一个比输入大1的数值; 当输入信号的数值为4,5,6,7时,输出是一个比输入小1的数值。

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第7题
试用CMOS传输门设计一个CMOS三态输出的两输入端与非门,画出逻辑电路并列出其真值表。

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第8题
设有一个4位二进制数X,送到一个判别电路。要求:①当4≤X≤7时,输出YA=1②>X≤3时,输出YB=1③当X≥8时,输出YC=1。
设有一个4位二进制数X,送到一个判别电路。要求:①当4≤X≤7时,输出YA=1②>X≤3时,输出YB=1③当X≥8时,输出YC=1。试用两片4位数字比较器74LS85与若干个逻辑门实现此判别电路。
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第9题
若输入为3位二进制数X=x2x1x0,分别用逻辑门和VHDL语言设计一个输出Y=X2的组合电路。
若输入为3位二进制数X=x2x1x0,分别用逻辑门和VHDL语言设计一个输出Y=X2的组合电路。
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