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[主观题]
题七图(a)所示时序逻辑电路中。设各触发器的初始状态均为“0”
题七图(a)所示时序逻辑电路中。设各触发器的初始状态均为“0”
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题七图(a)所示时序逻辑电路中。设各触发器的初始状态均为“0”
逻辑状态表,画出波形图。设各触发器初始状态为0。
图10.17(a)、(b)、(c)、(d)所示各触发器中,设触发器初始状态为0,并已知时钟脉冲CP的波形如图10.17(e)所示。试画出各触发器Q1,Q2,Q3,Q4的波形。
图21-63为一时序逻辑电路,试列出Q2,Q1,Q0的状态真值表,并根据图示CP脉冲波形画出Q2,Q1,Q0的波形图(设各触发器Q端初始为0)。
下图所示各触发器中,设触发器初始状态为0,并已知时钟脉冲CP的波形如图(b)所示。试画出各触发器输出端Q的波形。
逻辑电路如图4.2.47所示,各触发器初始状态为“0”。已知CP、A、B的波形,试画出Q0、Q1和F的波形。
在图13.7(a)所示电路中,已知输入端D和CP的波形如图13.7(b)所示。各触发器的初始状态均为0,求Q1和Q2的波形。