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[主观题]
某512位串行输入串行输出右移寄存器，已知时钟频率为4MHz，数据从输入端到输出端被延迟的时间为______。
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图13.15所示寄存器采用串行输入，输入数码为1001，但输出方式有两种，既可串行输出，又可并行输出。试分析：(1)该寄存器是右移寄存器还是左移寄存器？(2)画出前四个CP脉冲时，Q4，Q3，Q2和Q1的波形；(3)说明串行输出和并行输出的方法。
A.数据从RDX串行输入，从TXD串行输出
B.数据从RDX串行输出，从TXD串行输入
C.数据从RDX串行输入或输出，同步信号从TXD输出
D.数据从TXD串行输入或输出，同步信号从RXD输出
A．数据从RDX串行输入，从TXD串行输出
B．数据从RDX串行输出，从TXD串行输入
C．数据从RDX串行输入或输出，同步信号从TXD输出
D．数据从TXD串行输入或输出，同步信号从RXD输出
4位右移移位寄存器设计
实验要求
用原理图输入设计法或Verilog HDL文本输入设计法设计4位右移移位寄存器电路，建立4位右移移位寄存器的实验模式。通过电路仿真和硬件验证，进一步了解移位寄存器的功能和特性。
设计原理
4位右移移位寄存器的元件符号如图所示，CLK是时钟输入端，上升沿有效；CLRN是复位输入端，低电平有效；DSR是串行数据输入端；Q[3..0]是4位右移移位寄存器的状态输出端。
