题目内容
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[主观题]
试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为
试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为
(2)控制端X=1时,计数器的模M=4,计数规律为
试画出逻辑电路图。
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试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为
(2)控制端X=1时,计数器的模M=4,计数规律为
试画出逻辑电路图。
用同步时序电路设计一模6 的可逆计数器,当控制端X为1时,计数器做减法计数,当X为0时,计数器做加法计数(触发器用JK触发器)。
择。说明设计过程,画出逻辑图。
以上设计可以使用外加的逻辑门。
下表是十进制中规模计数器的功能表。
计数器还有进位输出F端,当加计数剑1001状态时产生进位负脉冲输出。
计数器的逻辑符号如图所示。
用同步二进制加法计数器74161(逻辑符号及功能表见附录)和一个3-8线译码器74138以及门电路设计一个具有开机消零功能的模7计数器,要求计数器按下列规律计数,要求写出设计过程,画出电路图:
0,4,9,12,3,6,9,0,4,…
试设计一个可控模同步计数器,它具有表5-27所示的功能。
M1
M2
功能
0
0
保持
0
1
模2计数
1
0
模4计数
1
1
模8计数