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[主观题]

用同步二进制加法计数器74161（逻辑符号及功能表见附录)和一个3－8线译码器74138以及门电路设计一个具有开机

用同步二进制加法计数器74161(逻辑符号及功能表见附录)和一个3-8线译码器74138以及门电路设计一个具有开机消零功能的模7计数器，要求计数器按下列规律计数，要求写出设计过程，画出电路图：

0，4，9，12，3，6，9，0，4，…

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第1题

试以同步二进制计数器74161为核心设计一个模10计数器，要求计数器按下列规律技术，并要求：（1)电路具有开机清

试以同步二进制计数器74161为核心设计一个模10计数器，要求计数器按下列规律技术，并要求：(1)电路具有开机清零功能；(2)写出电路设计过程并画出完整电路图(电路设计可加门和MSI组合逻辑电路)。

0，1，3，5，7，9，2，4，6，8，0，1，3，…

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第2题

用一片如图A1－4所示的4位二进制加法计数器74161和必要的逻辑门电路设计一个可控计数器，要求当控制信号M=1时

用一片如图A1-4所示的4位二进制加法计数器74161和必要的逻辑门电路设计一个可控计数器，要求当控制信号M=1时，实现七进制计数器；而当控制信号M=0时，实现十三进制计数器。画出所设计的可控计数器的逻辑电路。

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第3题

用最少的D触发器及适当的小规模门电路设计7进制同步加法计数器，要求电路能自启动，写出状态方程，并画出状态

转换图及相应的电路图。

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第4题

试用JK触发器设计一个变模计数器，要求：（1)控制端X=0时，计数器的模M=3，计数规律为

试用JK触发器设计一个变模计数器，要求： (1)控制端X=0时，计数器的模M=3，计数规律为

(2)控制端X=1时，计数器的模M=4，计数规律为

试画出逻辑电路图。

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第5题

用74194设计一个可控计数器，计数器有一个控制端X，当X=0时，电路为一个4位能自启动的环形计数器，其计数有效循

环如图(a)所示；当X=1时，电路为一个4位能自启动的环形计数器，其计数有效循环如图(b)所示。要求写出设计过程，画出电路图(设计可加必要的门电路，两循环之间允许有过渡状态)。

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第6题

图10.66所示为四位二进制加法计数器,其功能表见表10.16所示.试将两片CT74161采用同步级联方式

及总体反馈归零法设计成一个23进制计数器,要求写出设计过程并画出连接图.

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第7题

用双向移位寄存器74194设计一个按下图所示规律计数的能自启动的计数器。（要求写出设计过程)

用双向移位寄存器74194设计一个按下图所示规律计数的能自启动的计数器。(要求写出设计过程)

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第8题

试设计一个可控模同步计数器，它具有表5－27所示的功能。表5－27 可控模同步计数器功能表

试设计一个可控模同步计数器，它具有表5-27所示的功能。

表5-27 可控模同步计数器功能表

M₁

M₂

功能

0

0

保持

0

1

模2计数

1

0

模4计数

1

1

模8计数

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第9题

用十进制数中规模计数器设计一个可控计数器，当控制信号X=0时为模6计数，X=1时为模8计数，计数状态可以自己选

择。说明设计过程，画出逻辑图。

以上设计可以使用外加的逻辑门。

下表是十进制中规模计数器的功能表。

RESETbar{LOAD}CLKQ_DQ_CQ_BQ_A11φ复位全0状态φ0↑预置φ1↑加计数

计数器还有进位输出F端，当加计数剑1001状态时产生进位负脉冲输出。

计数器的逻辑符号如图所示。

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