题目内容
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[主观题]
试用D触发器设计一个序列检测器,该检测器有一串行输入X、一个输出Z,当检测到0100111时输出为1。
输入和输出的关系也可用下式表示:。
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设计一个串行数据检测器,该检测器有一个输入端X,它的功能是对输入信号进行检测。当连续输入三个1(以及三个以上1)时,该电路输出Y=1,否则该电路输出Y=0。
设计一个二进制序列信号检测器,它有一个输入X,当接收到的序列为1001,则在上述序列输入最后一个1的同时,电路输出Z=1,否则输出为0,输入序列可以重叠。例如:当输入X的序列为0100100101001(首位在左),对应输出Z=0000100100001。
时序改计:试用正边沿D触发器设计一个1101序列检测器,它有一个输入端和一个输出端(似定输入序列可以重叠)。
请用PAL16R6设计一个数据检测器,要求当串行数据X连续输入四个1时,电路输出Y为高电平。例如:
X=10101101111011111101…
Y=00000000001000011100…
设计一个代码检测器,电路串行输入余3码,当输入出现非法数字时电路输出为0,否则为1,试作出Mearly状态图。