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[单选题]

一个能为Verilog HDL综合器接受,并能作为一个独立的设计单元的完整的Verilog HDL程序称为()。

A.设计输入

B.设计输出

C.设计模块

D.设计结构

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第1题
VerilogHDL模块分为两种类型:一种是()模块,即,描述某种电路系统结构,功能,以综合或者提供仿真模型为设计目的;另一种是()模块,即,为功能模块的测试提供信号源激励、输出数据监测。

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第2题
在VerilogHDL模块中,函数调用时返回一个用于()的值。

A.表达式

B.输出

C.输入

D.程序包

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第3题
VerilogHDL很好地支持了“自顶向下”的设计理念,即,复杂任务分解成的小模块完成后,可以通过()的方式,将系统组装起来。

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第4题
将某个学科、某些相关学科的内容、某种活动或某些相关活动的内容,按主题重新组合成彼此连贯或相对独立的一个个模块,每个模块构成一个单元是()

A.课程设计

B.单元设计

C.分层设计

D.课时设计

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第5题
综合检测与维修专业设计单元可按照单个工点设计范围划分,如大型养路机械段、综合检测中心、综合维修段、综合工区等划分设计单元。一个段工区内,所有起重机设备都可划分为一个设计单元。()
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第6题
一个完整的Verilog HDL设计模块包括______、______、______和______4个部分。
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第7题
以下属于系统设计阶段的工作有()。

A.程序设计

B. 输入、输出设计

C. 数据库设计

D. 模块功能与处理过程设计

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第8题
将设计的系统按照EDA开发软件要求的某种形式表示出来,并送入计算机的过程,称为()。

A.设计的输入

B.设计的输出

C.仿真

D.综合

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第9题
用与非门设计一个4位的补码输出电路。电路输入是4位二进制数,输出为输入的补码。

用与非门设计一个4位的补码输出电路。电路输入4是4位二进制数,输出为输入的补码。

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