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[主观题]

74LS293型计数器的逻辑图，外引线排列图及功能表如题图所示，它有两个时钟脉冲输入端CP0和CP1。试问：（1) 从CP0

74LS293型计数器的逻辑图，外引线排列图及功能表如题图所示，它有两个时钟脉冲输入端CP₀和CP₁。试问：(1) 从CP₀输入，Q₀输出时，是几进制计数器？(2) 从CP₁输入，Q₃，Q₂，Q₁输出时，是几进制计数器？(3) 将Q₀端接到CP₁端，从CP₀输入，Q₃，Q₂，Q₁，Q₀输入时，是几进制计数器？图中R₀₍₁₎，和R₀₍₂₎是清零输入端，当该两端全为“1”时，将4个触发器清零。

74LS293型计数器的逻辑图，外引线排列图及功能表如题图所示，它有两个时钟脉冲输入端CP0和CP1

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第1题

74LS293型计数器的逻辑图，外引线排列图及功能表如图21.45所示。它有两个时钟脉冲输入端CP0和CP1。试问：（1)从C

74LS293型计数器的逻辑图，外引线排列图及功能表如图21.45所示。它有两个时钟脉冲输入端CP₀和CP₁。试问：(1)从CP₀输入，Q₀输出时，是几进制计数器？(2)从CP₁输入，Q₃，Q₂，Q₁输出时，是几进制计数器？(3)将Q₀端接到CP₁端，从CP₀输入，Q₃，Q₂，Q₁，Q₀输出时，是几进制计数器？图中R₀₍₁₎和R₀₍₂₎，是清零输入端，当该两端全为1时，将4个触发器清零。

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第2题

74LS293型计数器的逻辑图、外引线排列图及功能表如图21-39所示。它有两个时钟脉冲输入端CP0和CP1。试问（1)从CP

74LS293型计数器的逻辑图、外引线排列图及功能表如图21-39所示。它有两个时钟脉冲输入端CP₀和CP₁。试问(1)从CP₀输入，Q₀输出时，是几进制计数器？(2)从CP₁输入，Q₃，Q₂，Q₁输出时，是几进制计数器？(3)将Q₀端接到CP₁端，从CP₀输入，Q₃，Q₂，Q₁，Q₀输出时，是几进制计数器？图中R₀(1)和R₀(2)是清零输入端，当该两端全为1时，将四个触发器清零。

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第3题

74LS293型计数器的逻辑图、外引线排列图和功能表如图10.3.3所示。其中，CP 1、CP2是两个时钟脉冲输

人端:R0(1)和R0(2)是清零输人端，当该两端均为1时，将四个触发器清零。试问:(1)计数脉冲从CP0输入，Q0输出时，是几进制计数器？(2)计数脉冲从CP1输人，Q 3、Q 2、Q1输出时，是几进制计数器？(3)将74LS293接成图10.3.4所示电路时,是几进制计数器？

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第4题

用JK主从触发器和任何门电路，设计一个同步时序电路，如图7．2．6（a)所示。Q0、Q1为计数器输出端，F

用JK主从触发器和任何门电路，设计一个同步时序电路，如图7．2．6(a)所示。Q0、Q1为计数器输出端，F为分频输出端，X为控制端，CP为时钟脉冲端。当X=1时，Q0、Q1为加法计数器输出，F为4分频输出。当X=0时，Q0、Q1为减法计数器输出，F输出为1。 (2)把图7．2．6(a)所示时序电路外接若干器件，如图7．2．6(b)所示，试分析这个电路可构成一个几进制的计数器，简要说明理由。

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第5题

设计一个可控进制的计数器，当输入控制变量M=0时工作在五进制；M=1时工作在十五进制。请标出计数输入端和进位

输出端。

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第6题

试分析下图所示电路是几进制计数器，画出各触发器输出端的波形图。

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第7题

CT4193是2～16进制可预置同步可逆计数器。其逻辑符号如图所示。CT4193具有双时钟CP＋、CP－。加法计数时，从CP＋输入

CT4193是2～16进制可预置同步可逆计数器。其逻辑符号如图所示。CT4193具有双时钟CP+、CP-。加法计数时，从CP+输入计数脉冲，CP-=1；减法计数时，从CP一输入计数脉冲，CP+=1。CR是清零端，正脉冲有效，LD是预置端，低电平有效。C0为进位输出端，B0为借位输出端，它们都输出负脉冲。

试用CT4193，采用异步预置法组成十进制减法计数器。

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第8题

某计数器中3个触发器输出端Q0、Q1Q2的输出信号波形如图5．4．2所示，由波形图可知该计数器是________

________进制计数器。

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第9题

试用CC40160芯片构成二十四进制、六十进制的计数器。画出连线图,标明计数输入端和进位输出端。

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