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[主观题]

用PLA可编程逻辑阵列和D触发器设计能够进行加法计数和减法计数的两位二进制同步可逆计数器。当输入X=0时，进

行加法计数；当X=1时，进行减法计数。进位/借位信号为Y。画出PLA阵列的逻辑图。

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更多“用PLA可编程逻辑阵列和D触发器设计能够进行加法计数和减法计…”相关的问题

第1题

试用JK触发器设计一个2位同步二进制多功能计数器。当控制端XY=00时，计数器状态不变；XY=01时，为加

法计数；XY=10时，为减法计数；XY=11时，则次态为现态求反运算。试写出该计数电路的控制输入真值表(包括状态转换激励表)，并画出用与非门和JK触发器实现这一控制的逻辑电路图。

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第2题

S7-200有三种普通计数器，其中（)具有加计数和减计数两个输入端，通过获取对应计数输入信号的上升沿，进行加法、减法计数。

A.加计数器(CTU)

B.减计数器(CTD)

C.可逆计数器(CTUD)

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第3题

计数器按计数过程中数字的增减分类可以分为加法计数器、减法计数器和可逆计数器三种。（)

计数器按计数过程中数字的增减分类可以分为加法计数器、减法计数器和可逆计数器三种。()

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第4题

用JK触发器设计一个如图所示功能的同步计数器。当X=0时，计数器为8421码六进制加法；当X=1时，计数器值为循环码

六进制计数。

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第5题

在数字电路中，随着计数脉冲的输入，计数器的数是可增可减的，则这种计数器称为（)计数器。

A.可逆

B.加法

C.减法

D.递减

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第6题

用集成的4位二进制同步加法计数器和与非门可以实现任何计数容量小于16的计数器。（)

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第7题

可逆计数器是既可作加法又可作减法计数的计数器。该说法（)。

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第8题

试用边沿JK触发器和门电路设计一个按自然态序进行计数的七进制同步加法计数器。

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第9题

按照触发器翻转是否与计数脉冲同步分类，计数器可以分为()。

A.二进制计数器

B.非二进制计数器

C.同步计数器

D.异步计数器

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第10题

74LS192型同步十进制可逆计数器的功能表和逻辑符号分别如表21－4和图21－7所示。所谓可逆，就是能进行加法计数

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